Fitter Route Stage Report for gflish
Mon Feb 24 13:49:51 2020
Quartus Prime Version 18.0.0 Build 219 04/25/2018 SJ Pro Edition


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; Table of Contents ;
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  1. Legal Notice
  2. Delay Chain Summary
  3. Routing Usage Summary
  4. Route Messages
  5. Estimated Delay Added for Hold Timing Summary
  6. Estimated Delay Added for Hold Timing Details



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; Legal Notice ;
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; Delay Chain Summary                                                                                                                                          ;
+-------------+----------+---------------------+--------------------+----------------+-----------------------------------+-------------------------------------+
; Name        ; Pin Type ; Input Delay Chain 0 ; Output Delay Chain ; OE Delay Chain ; IO_12_LANE Input Data Delay Chain ; IO_12_LANE Input Strobe Delay Chain ;
+-------------+----------+---------------------+--------------------+----------------+-----------------------------------+-------------------------------------+
; clk_clk     ; Input    ; 0                   ; --                 ; --             ; --                                ; --                                  ;
; reset_reset ; Input    ; 0                   ; --                 ; --             ; --                                ; --                                  ;
+-------------+----------+---------------------+--------------------+----------------+-----------------------------------+-------------------------------------+


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; Routing Usage Summary                                       ;
+------------------------------+------------------------------+
; Routing Resource Type        ; Usage                        ;
+------------------------------+------------------------------+
; Block interconnects          ; 11,830 / 1,658,004 ( < 1 % ) ;
; C27 interconnects            ; 57 / 27,053 ( < 1 % )        ;
; C4 interconnects             ; 6,379 / 1,181,752 ( < 1 % )  ;
; Direct links                 ; 1,971 / 1,658,004 ( < 1 % )  ;
; Global clocks                ; 1 / 32 ( 3 % )               ;
; Periphery clocks             ; 0 / 577 ( 0 % )              ;
; R3 interconnects             ; 3,200 / 557,136 ( < 1 % )    ;
; R32 interconnects            ; 26 / 49,862 ( < 1 % )        ;
; R32/C27 interconnect drivers ; 59 / 175,848 ( < 1 % )       ;
; R6 interconnects             ; 5,181 / 1,100,860 ( < 1 % )  ;
; Regional clock lefts         ; 0 / 12 ( 0 % )               ;
; Regional clock out bottoms   ; 0 / 12 ( 0 % )               ;
; Regional clock out tops      ; 0 / 12 ( 0 % )               ;
; Regional clock rights        ; 0 / 12 ( 0 % )               ;
; Regional clocks              ; 0 / 12 ( 0 % )               ;
; Spine buffers                ; 2 / 484 ( < 1 % )            ;
; Spine clocks                 ; 3 / 726 ( < 1 % )            ;
; Spine feedthroughs           ; 0 / 544 ( 0 % )              ;
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; Route Messages ;
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Info: *******************************************************************
Info: Running Quartus Prime Fitter
    Info: Version 18.0.0 Build 219 04/25/2018 SJ Pro Edition
    Info: Processing started: Mon Feb 24 13:46:17 2020
Info: Command: quartus_fit --read_settings_files=on --write_settings_files=off gflish -c gflish
Info: qfit2_default_script.tcl version: #1
Info: Project  = gflish
Info: Revision = gflish


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; Estimated Delay Added for Hold Timing Summary                  ;
+---------------------+----------------------+-------------------+
; Source Clock(s)     ; Destination Clock(s) ; Delay Added in ns ;
+---------------------+----------------------+-------------------+
; altera_reserved_tck ; altera_reserved_tck  ; 497.9             ;
; clk_clk             ; clk_clk              ; 306.1             ;
+---------------------+----------------------+-------------------+
Note: For more information on problematic transfers, consider running the Fitter again with the Optimize hold timing option (Settings Menu) turned off.
This will disable optimization of problematic paths and expose them for further analysis using the Timing Analyzer.


 
; Estimated Delay Added for Hold Timing Details                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                       ;
 
; Source Register                                                                                                                                                                                                                                                  ; Destination Register                                                                                                                                                                                                                                         ; Delay Added in ns ;
 
; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|irsr_reg[6]                                                                                                                                                                     ; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|prev_irsr_sel_reg[1]                                                                                                                                                        ; 1.757             ;
; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|identity_contrib_shift_reg[1]                                                                                                                                                   ; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|mix_writedata[1]                                                                                                                                                            ; 1.749             ;
; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|identity_contrib_shift_reg[0]                                                                                                                                                   ; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|mix_writedata[0]                                                                                                                                                            ; 1.748             ;
; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|identity_contrib_shift_reg[2]                                                                                                                                                   ; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|mix_writedata[2]                                                                                                                                                            ; 1.745             ;
; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|identity_contrib_shift_reg[3]                                                                                                                                                   ; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|mix_writedata[3]                                                                                                                                                            ; 1.726             ;
; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|irsr_reg[5]                                                                                                                                                                     ; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|hub_mode_reg[0]                                                                                                                                                             ; 1.677             ;
; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|reset_ena_reg                                                                                                                                                                   ; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|hub_mode_reg[2]                                                                                                                                                             ; 1.596             ;
; jtag_uart|jtag_uart_0|gflish_jtag_uart_0_altera_avalon_jtag_uart_180_tj65noi_alt_jtag_atlantic|td_shift[10]                                                                                                                                                      ; jtag_uart|jtag_uart_0|gflish_jtag_uart_0_altera_avalon_jtag_uart_180_tj65noi_alt_jtag_atlantic|td_shift[9]                                                                                                                                                   ; 1.525             ;
; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|jtag_ir_reg[7]                                                                                                                                                                  ; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|jtag_ir_reg[6]                                                                                                                                                              ; 1.522             ;
; jtag_uart|jtag_uart_0|gflish_jtag_uart_0_altera_avalon_jtag_uart_180_tj65noi_alt_jtag_atlantic|count[9]                                                                                                                                                          ; jtag_uart|jtag_uart_0|gflish_jtag_uart_0_altera_avalon_jtag_uart_180_tj65noi_alt_jtag_atlantic|td_shift[9]                                                                                                                                                   ; 1.519             ;
; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|shadow_jsm|state[8]                                                                                                                                                             ; auto_fab_0|alt_sld_fab_0|alt_sld_fab_0|sldfabric|\jtag_hub_gen:real_sld_jtag_hub|shadow_jsm|state[1]                                                                                                                                                         ; 1.500             ;
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Note: This table only shows the top 100 path(s) that have the largest delay added for hold.


