成功! 購読を追加しました。
成功! 購読を解除しました。
この操作を完了するには認証が必要です。お手数ですが、メール内の認証リンクをクリックしてください。次のリンクから再送信できます。 プロファイル.
アイコン | タイトル | 投稿 | Recent Message Time Column![]() |
---|---|---|---|
Programmable Devices
CPLDs, FPGAs, SoC FPGAs, Configuration, and Transceivers
| 100872 件の投稿 | 10-07-2025 11:32 PM | |
FPGA Intellectual Property
PCI Express*, Networking and Connectivity, Memory Interfaces, DSP IP, and Video IP
| 30910 件の投稿 | 10-02-2025 12:14 AM | |
FPGA, SoC, And CPLD Boards And Kits
FPGA Evaluation and Development Kits
| 30394 件の投稿 | 10-07-2025 10:59 PM | |
Intel® FPGA University Program
University Program Material, Education Boards, and Laboratory Exercises
| 5250 件の投稿 | 10-02-2025 06:53 AM | |
Application Acceleration With FPGAs
Programmable Acceleration Cards (PACs), DCP, FPGA AI Suite, Software Stack, and Reference Designs
| 2795 件の投稿 | 08-24-2025 07:49 PM | |
Nios® V/II Embedded Design Suite (EDS)
Support for Embedded Development Tools, Processors (SoCs and Nios® V/II processor), Embedded Development Suites (EDSs), Boot and Configuration, Operating Systems, C and C++
| 54115 件の投稿 | 09-29-2025 10:57 PM | |
Intel® SoC FPGA Embedded Development Suite
Support for SoC FPGA Software Development, SoC FPGA HPS Architecture, HPS SoC Boot and Configuration, Operating Systems
| 3394 件の投稿 | 09-30-2025 03:56 AM | |
Intel® Quartus® Prime Software
Intel® Quartus® Prime Design Software, Design Entry, Synthesis, Simulation, Verification, Timing Analysis, System Design (Platform Designer, formerly Qsys)
| 87361 件の投稿 | 10-02-2025 06:07 AM | |
Intel® High Level Design
Support for Intel® High Level Synthesis Compiler, DSP Builder, OneAPI for Intel® FPGAs, Intel® FPGA SDK for OpenCL™
| 3969 件の投稿 | 09-30-2025 06:11 PM | |
Intel® FPGA Software Installation & Licensing
Installation and Licensing that’s includes Intel Quartus® Prime software, ModelSim* - Intel FPGA Edition software, Nios® II Embedded Design Suite on Windows or Linux operating systems.
| 6747 件の投稿 | 10-05-2025 04:23 AM | |
FPGA Wiki
Welcome to the Intel FPGA Wiki
| 341 件の投稿 | 11-03-2022 01:29 PM |
投稿者 Arthi1 ビギナー イン Programmable Devices 10-07-2025 0 0 | 0 | 0 | ||
0 | 2 | |||
投稿者 Takashi69 ビギナー イン FPGA, SoC, And CPLD Boards And Kits 10-07-2025 0 1 | 0 | 1 | ||
0 | 0 | |||
0 | 2 | |||
0 | 2 | |||
投稿者 chazab ビギナー イン Intel® Quartus® Prime Software 10-02-2025 0 0 | 0 | 0 | ||
投稿者 MohamedSalem ビギナー イン FPGA Intellectual Property 10-02-2025 0 1 | 0 | 1 | ||
投稿者 Wiede ビギナー イン Programmable Devices 10-01-2025 0 12 | 0 | 12 | ||
投稿者 Raymart_Julian ビギナー イン Programmable Devices 10-01-2025 0 9 | 0 | 9 | ||
投稿者 Santoshmbca ビギナー イン FPGA, SoC, And CPLD Boards And Kits 10-01-2025 0 1 | 0 | 1 | ||
投稿者 anonimcs 新規コントリビューター III イン Intel® Quartus® Prime Software 10-01-2025 0 4 | 0 | 4 | ||
投稿者 MasanSigi ビギナー イン Intel® Quartus® Prime Software 10-01-2025 0 2 | 0 | 2 | ||
0 | 1 | |||
投稿者 SteveS109 ビギナー イン Intel® Quartus® Prime Software 10-01-2025 0 22 | 0 | 22 |
Implementing MIPI DSI-2 on an Agilex 5 device 投稿者 SteveS109 10-01-2025 0 22 |
Issue with Pixel Buffer DMA AVMM -> AXI connection on DE25-Standard (Agilex5) 投稿者 Wiede 10-01-2025 0 12 |
Quartus 25.1.1 Pro Fitter Error with Agilex3 投稿者 SteffenP 09-28-2025 0 10 |
コミュニティーのサポートは、月曜日から金曜日まで提供されています。その他の連絡方法については、 こちらをご覧ください。
インテルは、すべてのソリューションを検証するものではありません。ここにいうソリューションには、このコミュニティーで行われる可能性のある、あらゆるファイル転送が含まれますが、これに限定されません。したがって、インテルは、明示されているか否かにかかわらず、いかなる保証もいたしません。ここにいう保証には、商品適格性、特定目的への適合性、および非侵害性の黙示の保証、ならびに履行の過程、取引の過程、または取引での使用から生じるあらゆる保証を含みますが、これらに限定されるわけではありません。
コンパイラーの最適化について、さらに詳しい情報をお知りになりたい場合は、以下を参照してください: 最適化に関する注意事項.